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求教VHDL编写三相输入

2019-07-15 22:44发布

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我的VHDL测试文件中要求有三相输入，分别是Uab(t)=128sin(327t+120°)，Ubc(t)=128sin327t，Uca(t)=128sin(327t+240°)。
求教如何转成把这三个式子编写成VHDL语言输入
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1条回答
ha*ke
1楼-- · 2019-07-16 02:52
sin函数写成表，使用RAM来实现。
相同的幅度，可以忽略；如果非要加个期限，乘以128，即低位增加7比特0.

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