1664屏，ABCD STB OE 信号正常，CLK一接51就低电平，何解？

2020-02-01 16:36发布

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15条回答

1楼-- · 2020-02-01 17:26

天啊，这个245的4脚与地间只有400欧的电阻。。。。。。

2楼-- · 2020-02-01 22:58

gracialee 发表于 2012-9-11 17:53
天啊，这个245的4脚与地间只有400欧的电阻。。。。。。

那已经相当于强下拉电阻了

3楼-- · 2020-02-02 03:19

精彩回答 2 元偷偷看……

4楼-- · 2020-02-02 06:34

gracialee 发表于 2012-9-12 14:07
谢楼上的，可这是595的时钟信号啊，，，，没这个信号，这屏就没得玩了，哪位亲有595的CLK保护，耦合等辅助 ...

从IO接个10K电阻到IC的引脚试试

5楼-- · 2020-02-02 09:38

gaoyichuan000 发表于 2012-9-12 19:04
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2012-9-12 23:37 上传

6楼-- · 2020-02-02 12:50

gracialee 发表于 2012-9-12 23:37
你是说把CLK接１０K电阻后再进屏的输入口？还是加１０K电阻后直接进屏的５９５的１１脚？

另外，我画了 ...

加电阻后到595的输入引脚这样相当于加大了下拉电阻阻值单片机IO内部的上拉电阻应该可以把他拉回高电平