FPGA

高速adc接口问题

2020-01-30 15:56发布

站内问答 / FPGA
5869 3 3
现在在设计一个1ghz采样的ad，发现adc输出是按照多路同时输出降低速率的，但是数据到了fpga那边就变成几倍的数据宽度 ，而且fpga根本没有办法处理上g的数据率，是我理解有误还是有什么方法。
友情提示: 此问题已得到解决，问题已经关闭,关闭后问题禁止继续编辑，回答。
该问题目前已经被作者或者管理员关闭, 无法添加新回复
2条回答
钻研的鱼
1楼-- · 2020-01-30 21:34
fpga处理上g速率的数据是没有问题，xilinx系列都可以处理1.4g的速度。
fpga外接ddr3或者ddr4等，都是上g的速率。难点是怎样将数据与时钟对齐，保证fpga抓到的是可靠的数据
zhangmangui
2楼-- · 2020-01-31 01:33
你说的是并行过来的数据速率这么高吗   一般LVDS都是两组总线把速度降下来了
还有就是抽样

一周热门 更多>