【锆石科技】关于 Verilog HDL 语言的一些关键问题解惑

2020-01-26 16:22发布

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本帖最后由 21ic小喇叭于 2016-8-17 09:22 编辑

本文档主要包含了 Verilog HDL语言的八个关键问题

它们分别是：

① Verilog的抽象级别

② Verilog的模块化设计

③ 如何给端口选择正确的数据类型

④ Verilog语言中latch的产生

⑤ 组合逻辑反馈环

⑥ 阻塞赋值与非阻塞赋值的不同

⑦ FPGA的灵魂状态机

⑧ 代码风格的重要性

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