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FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。

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vivado+zedboard之纯PL开发基本流程

环境:win7 64   vivado 2014.1开发板:zedboard version d    xc7z020clg484-1目标:在vivado环境下进行传统的FPGA开发,对zynq来说,也可以叫做纯PL开发。本文重点介绍纯P...

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OpenRisc-32-ORPSoC烧写外部spi flash

引言 经过前面的分析和介绍,我们对ORPSoC的启动过程(http://blog.csdn.net/rill_zhen/article/details/8855743)和 ORpSoC的debug子系统(http://blog.csdn.net/rill_zhen/article/details/9045837)有了初步的了解, 但是对于启动和debu...

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usb_Blaster 驱动安装

喵喵~~Altera FPGA 编程,烧写程序突然发现USB_Blaster驱动没安装,喵喵~~,不要急着从度娘搜素安装驱动,其实QuartusII 自带驱动,驱动软件的路径在哪呢?喵喵~~,具体怎么安装,不多说了,喵喵~~ ...

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硬件开发的EDA工具

原文地址:http://www.cnblogs.com/oomusou/archive/2011/10/10/linux_quartus.html 1.絕大部分的EDA工具都在Linux平台上: 如Synopsys、Cadence、SpringSoft等公司的EDA工具都在Linux平台上,在Windows平台只剩下FPGA工具如Altera Quar...

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静态时序分析初步认识

静态时序分析是学习FPGA必须学习的一个知识点,通过一段时间的学习,先将自己所学到的一点静态时序分析的基础稍作总结。 这是一张再熟悉不过的图形,以及两个基础公式 Tperiod>Tcko+Tlogic+Tnet+Tsetup-Tclk_skew ...

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PLD/FPGA 结构与原理初步(一)

PLD/FPGA 结构与原理初步(一)   来自:http://www.fpga.com.cn/     一.基于乘积项(Product-Term)的PLD结构   采用这种结构的PLD芯片有:Altera的MAX7000,MAX3000系列(EEPROM工艺),Xilinx的XC9500系列(Fl...

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融合

计算系统: 服务器 —— 大型计算和应用,面向群体 PC和Mobile —— 消费品,面向个体 服务器暂不看。 消费品: 芯片:ARM和Intel。 附在其上的辅助芯片 —— DSP/FPGA/ShowChip/WirelessConnectChip etc. 操作系统:Andriod,Apple,...

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FPGA工程师:从绝望到绝地逢生

大学时代第一次接触FPGA至今已有10多年的时间,至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验...

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深度学习FPGA实现基础知识10(Deep Learning(深度学习)卷积神经网络(Convolu

需求说明:深度学习FPGA实现知识储备 来自:http://blog.csdn.net/stdcoutzyx/article/details/41596663 说明:图文并茂,言简意赅。 自今年七月份以来,一直在实验室负责卷积神经网络(Convolutional Neural Network,CNN),期间配置和使...

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M研制出千核微处理器 电脑运算速度提高20倍

内核是读取和执行指令的计算机CPU的一个组件,现代计算机的CPU一般拥有2个、4个或16个内核。然而,英国格拉斯哥大学的维姆·范德鲍惠德和美国马萨诸塞大学卢维尔分校的科学家研制出的新式CPU,在一个芯片上有效集成了1000多个内核。    ...

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从零开始VCS+Verdi 安装及破解过程

从零开始VCS+Verdi 安装及破解过程 主要参考:VCS+Verdi 安装及破解过程(CentOS7)-----FPGA开发 想要一个纯净的系统,所以在虚拟机上直接重新安装了空白的Ubuntu 16.04。然后(⊙﹏⊙)别人写的好简略啊,我咋一遍也出不来啊,磨了我...

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QuartusII 13.0自带的Modelsim Altera 10.1d破解

做FPGA用到ModelSim仿真,QuartusII 13.0调用发现"unable to check out a license .run the modelsim licensing wizard from start.programs menu to dignose problem" 的问题,才发现Quarttus13.0破解后还要再破解Modelsim,方法如下.....

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PLL模块使用中的一些错误

最近使用pll模块产生一些FPGA内部时钟,发现错误一大堆,费了好半天终于弄明白了。 1.综合时的错误 ERROR:Xst:2035 - Port has illegal connections. This port is connected to an input buffer and other components. Input Buffer: ...

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pcie--调试(一)

使用xilinx的v6开发fpga,使用ip核生成代码,下载调试,pcitree能找到设备,可是PC不认。 最后发现是在生成ip核的时候class code设置与电脑一样,修改class code后,重新下载,电脑识别成功! ...

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Linux 用户空间spi读写外围驱动

下面是Linux用户空间spi读写外围芯片的驱动程序,例如bcm交换芯片,FPGA等,大同小异,根据实际芯片时序图修改即可。 /*  * SPI testing utility (using spidev driver)  *  * Copyright (c) 2007  MontaVista Software, Inc.  * Copy...

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zcu102_9_hello_petalinux

class="markdown_views prism-atom-one-light"> 文章目录安装PetaLinux硬件设计生成镜像运行PetaLinuxLinux程序 本文配套原码工程及编译生成的镜像文件已上传至https://download.csdn.net/download/botao_li/10938035 由于...

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我的科研生活2017-3-13

为了优化fPGA 实现, 瓷瓷实实的看了一天 hls文档,  晚饭的时候找另外两个同学吃了个火锅, 发泄了一下。 感觉不错。 聊天发现,原来大家都差不多。  明天继续看文档,这把提高很大。有希望了。 ...